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考研論壇

標(biāo)題: 高薪芯片測試開發(fā)課程開課了, [打印本頁]

作者: IC集成電路 時間: 2018-11-19 13:44
標(biāo)題: 高薪芯片測試開發(fā)課程開課了,
E課網(wǎng)曾為半導(dǎo)體行業(yè)培養(yǎng)輸送了眾多芯片研發(fā)重要崗位的人才，均受到了學(xué)員以及企業(yè)HR的一致好評，面對國內(nèi)芯片測試開發(fā)人才的緊缺，E課網(wǎng)聯(lián)合摩爾精英測試專家開發(fā)，并與全球著名的自動測試設(shè)備供應(yīng)商泰瑞達(dá)（Teradyne）聯(lián)合認(rèn)證，推出了高薪芯片測試開發(fā)課程，選擇芯片測試開發(fā)工程師為導(dǎo)向，面向高校應(yīng)屆本科生研究生和在職人員，大規(guī)模培養(yǎng)芯片測試開發(fā)人才。

作者: IC集成電路 時間: 2018-11-19 13:47
#在這里快面向?qū)ο?（1）理工類應(yīng)屆生本科生、研究生。（2）想轉(zhuǎn)行芯片測試開發(fā)的在職人員。（3）測試開發(fā)在職人員。速回復(fù)#

作者: IC集成電路 時間: 2018-11-19 13:48
面向?qū)ο?br /> （1）理工類應(yīng)屆生本科生、研究生。
（2）想轉(zhuǎn)行芯片測試開發(fā)的在職人員。
（3）測試開發(fā)在職人員。

作者: IC集成電路 時間: 2018-11-19 13:51
（1）學(xué)生完成所有培訓(xùn)內(nèi)容，可以為成為芯片測試開發(fā)工程師打好扎實(shí)基礎(chǔ)。
（2）初級芯片測試開發(fā)工程師目標(biāo)薪資月薪8~10K。工作1-2年后，預(yù)計(jì)月薪達(dá)到14~18K以上。

作者: IC集成電路 時間: 2018-11-19 13:53
開課時間：
2018年11月20日周二晚上20：30。
上課時間：
每周二、周四晚20：30-22：30；
周六：9：30-11：30，14：00-16：00。
為期3周。

作者: IC集成電路 時間: 2018-11-19 13:54
課程詳細(xì)大綱

序號
課程內(nèi)容
課時數(shù)
1
?  芯片設(shè)計(jì)基本流程
產(chǎn)品規(guī)格
架構(gòu)算法
RTL代碼
仿真驗(yàn)證
工藝選擇
綜合、時序、功耗分析
形式驗(yàn)證
自動布局布線
制造
封裝
測試
2小時
2
?  測試開發(fā)流程
測試需求
測試需求分析
測試計(jì)劃
DFT方案與實(shí)施
IP測試方案與實(shí)施
測試程序開發(fā)
測試治具設(shè)計(jì)
測試治具制造
測試程序調(diào)試
測試量產(chǎn)導(dǎo)入
2小時
3
?  芯片測試專業(yè)知識
測試系統(tǒng)介紹
Pin Electronics
測試開發(fā)基本原則
基于PMU的開短路測試
DC參數(shù)測試
功能測試
AC參數(shù)測試
2小時
4
?  向量轉(zhuǎn)換工具介紹與使用
TDL工具簡介
VCD2STIL使用介紹
ATEgen使用介紹
Waver使用介紹
Timing editor使用介紹
項(xiàng)目實(shí)踐
2小時
5
?  測試硬件的介紹與使用
Loadboard設(shè)計(jì)、仿真
Socket設(shè)計(jì)、仿真
Probecard設(shè)計(jì)
Changekit設(shè)計(jì)
6小時
6
?  工藝基礎(chǔ)知識
光刻工藝簡介
CVD工藝
Sputter工藝
蒸發(fā)工藝
I/I工藝
擴(kuò)散工藝
濕法刻蝕
干法刻蝕
2小時
7
?  DFT基礎(chǔ)知識
Mbist介紹
Scan介紹
JATG-TAP/ATPG介紹
ATE測試故障診斷（Diagnosis）
6小時
8

?  封裝基礎(chǔ)知識
什么是封裝
為什么要封裝
封裝的形式
封裝的流程
封裝的發(fā)展和趨勢
2小時

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